| 1769-PB2 为了测试本文提出的设计方案的正确性和有效性，在设计过程中选取了一些常用的数字电路系统来比较C源程序和VHDL目标程序的功能一致性。例如对于一个无控制端口的加法器电路，其电路示意图见图2
该加法器不带任何控制端口，有两个输入端口in1和in2，一个输出端口pout，它们的类型皆为位向量。当输入信号中有任何一个或者两个都发生变化时，进程就要再重新执行一遍。从电路功能的角度来理解：只要在输入端有新的数据输入，那么加法器必然要重新开始工作，将新的数值相加并送到输出端口，这样不断地进行加法操作。对于加法器电路的C语言描述如下
利用本文提出的设计方案对实现加法器功能的C 语言程序进行编译转换， 得到转换后的目标程序———VHDL 程序如下：
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